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  • 基于DSP的JPEG视频压缩系统的实现

    统硬件结构图。 该系统硬件设计以ti公司的tms320vc5509a型数字信号处理器为核心，包括视频采集电路、fpga预处理电路、存储器扩展、系统电源和看门狗电路等。系统中tms320vc5509a为中央处理器；sdram为dsp外扩数据存储器；flash为程序存储器，用于系统上电自举；模拟摄像头与视频 a／d转换器负责视频图像采集；fpga用于地址译码、隔行运算，控制两片sram用于缓存视频a／d转换器转换后的数字图像。从系统设计成本考虑，这里选用altera公司的可编程逻辑器件epic6q240c8型fpga。该器件是cyclone系列器件中一款非bga封装的可用i／o引脚最多的 fpga。 3．1 视频采集电路 该系统选用的视频解码器为philip公司的高性能视频a／d转换器saa7111。该器件是一款广泛应用于桌面视频、多媒体、数字电视、图像处理、视频电话的高性能视频输入处理器件。该器件采用3．3 v的cmos电路，高度集成模拟前端和数字视频编码器；包括2路模拟视频处理通道，1个时钟产生电路，1个自动箝位和自动增益控制电路，1个多制式数字解码器，1个亮度／对比度／饱和度控制

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EPF6016TC144-3 EPF6016ATC100 EPF6016 EPF6010ATC100-1 EPF10K70RC240 EPF10K50VRC240-4 EPF10K50VQC240 EPF10K50 EPF10K30RC240-3 EPF10K30RC240

EPM10K20TC144-4 EPM1270 EPM1270F256C5ES EPM1270T144 EPM2210 EPM240 EPM240GT100C5 EPM240T100 EPM240T100C5 EPM240T100C5N

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