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sn54hc193中文资料

  • 基于VerilogHDL的背景噪声扣除电路设计

    计方法，经仿真验证和综合后，得到了具有通用接口和软件易于操作的背景噪声电路，弥补了原有单元的不足，取得了较好结果。 2 背景噪声扣除电路原理 紫外光谱遥感仪器电控部分由斩光器，精密高压电源及光电倍增管，单片机控制单元，同步累加解调单元，前置低噪声放大器，压频转换组成。其中斩光器将空间辐射光斩切成为交替的“信号+背景”和“背景”的光信号，使得光电倍增管输出的信号如图1所示。调制后的信号放大后，经压频转化后变为频率信号，通过同步累加单元的处理。同步累加解调单元采用四片四位二进制加减计数器sn54hc193进位位相连组成16位加减计数器，并配以逻辑门电路组成实现的。背景噪声的扣除功能是依靠16位加减计数器由时序控制，在通光状态下加计数，在遮光状态下减计数，经多周期计数实现。 图1经斩光器调制后由光电倍增管输出的信号 背景噪声扣除原理简单，但时序控制较繁琐。原有电路因布线面积和硬件芯片不易过多等诸多考虑，计数周期及启停控制采用软件两次中断设置来实现。如图2所示第一次为中断本文课题来源于国家自然科学基金资助项目项目批准号：60538020为启动计数，查询到斩光器信号第一个上升沿时进

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