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TLK2201AJR 1.0 至 1.6Gbps 千兆以太网收发器 TI TLK2201AJRPDF下载
TLK2201ARCP ETHERNET TRANSCEIVERS TI [Texas Instruments] TLK2201ARCPPDF下载
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TLK2201AJRGQE 1.0Gb to 1.6Gb SMALL FORM-FACTOR ETH... TI [Texas Instruments] TLK2201AJRGQEPDF下载
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基于SoC的千兆EPON ONU硬件平台
c6进行数据交互。以太网络的接人是在fpga之后经gmii/mii接口和以太网收发芯片88e1111相连，实现千/百/十兆以太网络数据交换。fpga作为onu的核心单元。除数据传递通路外，硬件系统还包括sdram、eeprom、flash和一个uart串口。在plant side端，由于从光纤上传输的信号速率为1.25gb/s，fpga直接处理频率这么高的信号是不合适的，即使可行对于后期的asic芯片工艺设计也不容易实现。所以在fpga之前加入一个串并变换模块，此模块通过一个serdes芯片tlk2201a实现1.25gb/s串行数据与10位125mb/s并行数据信号的转换。再将这10位tbi信号和fpga相连,这样fpga的io口速率就可降至125mhz，由此fpga的逻辑时钟频率也设置为125mhz。fpga通过增设使能信号tbi_burst_en控制光模块的突发功能。在local side端．采用marvell的88e1111千兆以太收发芯片,支持1000base-t、100base-tx和10base-t自适应应用[4],并通过gmii/mii接口和fpga进行数据传递。当一个olt连

TLK2201A
每秒1～1.6Gbit/s串行器/解串器；低功率消耗：在1.25Gbit/s时＜250mW、LVPECL兼容差分输入输出在高速接口；单片集成电路PLL设计；支持10位接口或减少接口5位DDR(双倍数据速率)时钟；接收差分输入阈值：最小值200mV；符合IEEE802.3千兆以太网，先进的0.25μmQCMOS技术；无外部滤波电容器；内置式可测综合套件；支持IEEE1149.1JTAG；2.5V操作电源电压；LVTTL输入3.3V容错；热插拔保护；64引脚具有耐热增强型HVQFP封装(PowerPADTM)