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  • DCT域数字水印算法的FPGA实现

    控制双端口ram的运行;产生存储器的读写地址和控制运算流程等。 4 实验结果 在整个电路设计过程中,首先进行计算机matlab仿真,验证算法的正确性,然后以xilinx公司的ise9.1i可编程逻辑器件开发系统作为开发工具,采用可综合的vhdl语言描述dct变换设计。使用xilinx spartan3 xc3s200完成整个电路设计,spartan3系列器件嵌有18 bit×18 bit补码乘法器和大量ram块,非常适合dct变换。在xilinx公司集成设计环境ise9.1i下,选用xc3s200-4ft256器件实现综合和仿真,综合后最高时钟频率达98.592 mhz。并对布局布线后的设计用mentor graphics公司的modelsim se6.1f进行仿真。表1给出2d-dct变换时fpga器件的使用情况。 器件的功能引脚示意图,如图4所示。其中,xin(7:0)为待转换的8位数据输入端,clk为时钟信号输入端,rst为复位端,dct_2d(11: 0)为12位的dct转换结果,rdy_out是转换结果就绪指示。dct变换的逻辑功能如图5所示的时序仿真波形。

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