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icxd1=(xa-yb+xc+yd)wrd+(ya+xb-yc-xd)widyd1=(ya+xb-yc-xd)wrd+(xa-yb+xc+yd)wid可以看出，基4的蝶形运算单元可以同时输入输出四个数据进行并行蝶形运算，这就比基2蝶形运算的速度提高一倍。从运算公式还可以看出，基4fft运算需要12个乘法器，如果数据仍取32位，则需要12×8=96个8位乘法器，再考虑到参考函数相乘需要的4×8=32个8位乘法器，一共需要96+32=128个8位乘法器。采用stratix系列的ep1s60及ep1s60以上的芯片就可以实现。图6是64点基4fft前两级的流程图。在研制过程中，对基4fft也进行了软件编程和仿真调制，选用的是用altera公司的ep1s60f1020c60芯片实现基4方式的16k点数据压缩，达到了预期的目的。 1．3 fpga中实现fft的几个关键技术1．3．1 运算中的精度和溢出问题在fft运算过程中，一个数据要经过很多次的乘法和加法。以4k点fft运算为例，一共有12级运算，每一级运算又是由两级加法和一级乘法运算构成，也就是说，原始数据要经过24级加法和1
设计要求。 1 stratix系列器件的主要特性 同其它含有嵌入式fir core的cpld相比较，stratix系列cpld采用了1.5v内核，0.13μm全铜工艺，由quartusii 2.0以上版本软件支持，可以重复编程，通过jtag接口或者eprom加载程序，内部有dsp模块、pll、大带宽高速i/o接口和大容量存储模块。主要内部资源参见表1。表1 stratix器件内部资源表 内部资源 ep1s10 ep1s20 ep1s25 ep1s30 ep1s40 ep1s60 ep1s80 ep1s120 逻辑单元 10,570 18,460 25,660 32,470 41,250 57,120 79,040 114,140 m512 ram模块 94 194 224 295 384 574 767 1,118 m4k ram模块 60 82 138 171 183 292 364 520 megaram模块 1 2 2 4 4 6 9 12 ram总量（bit）
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