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制权,开始流水线的下一个周期。各个步骤对三片帧缓存ram的控制次序如图2所示。这种流水线式的电路结构实现了图像采集、图像处理、图像传输三个步骤并行工作,极大地提高了处理的连续性和实时性。2 dsp硬件设计dsp在本系统中的任务有三个:首先是通过链路层和物理层芯片与根节点通信,完成自标识过程;其二是处理采集好的一帧图像,并把它再存回帧缓存;其三是自标识完成后,响应根节点发来的数据读请求,从帧缓冲ram中读出处理过重的图像数据并送到总线上。整个系统由一片tms320vc33、一片20万门的fpga(ep20k200ebc356)、五片512kb高速sram(is61lv5128al)、一片flash(am29lv400b)、一片1394链路层芯片(tsb12lv32)、一片1394物理层芯片(tsb41lv04a)以及dsp电源看门狗芯片(ps767d301)组成。其中tms320vc33作为主控制器与tsb12lv32的主控制器接口相连。fpga在dsp的控制下向1394链路层芯片的datamover端口发送数据。此外fpga还有地址译码、时序调整以及帧缓存切换等功能。三片sram作为帧缓冲存,另外两片作为dsp的